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1—Llogisim-evolution / logisim-evolution数字逻辑设计工具和模拟器JavaGPL-3.0 · 需开源衍生作品名次历史不足7,8811,051——2026-11-03
3—Oopen-sdr / openwifi开源IEEE 802.11 WiFi基带FPGA（芯片）设计：驱动、软件CAGPL-3.0 · 需开源衍生作品名次历史不足4,857828——2026-10-22
5—Vverilator / verilatorVerilator开源SystemVerilog模拟器和lint系统SystemVerilogNOASSERTION · 限制商用 / 未知名次历史不足4,053965——2026-11-03
6—Cchili-chips-ba / wireguard-fpga使用低成本 Artix7 FPGA 和开源工具链，全速、线速硬件实施 Wireguard VPN。如果您寻求安全和隐私，我们的代码库中没有任何内容是私密的。我们对后门审查敞开大门，无论是与 RTL、嵌入式、构建、比特流还是设计和交付包的任何其他方面相关。布吉鲁姆！SystemVerilogBSD-3-Clause · 宽松，可直接商用名次历史不足1,37838——2026-11-02
商用三档依据许可证元数据自动分类；具体义务需结合实际使用方式核对。未知不等于禁止商用。